feat(adc): 新增变比维 r 三维折算，录波段格式升 v2

采样板注入 Ua=5V/Ia=0.5A 读数偏小，根因是固件只输出引脚电压、
缺「端子→引脚」变比。折算改三维：

工程量 = (code + b) × k[µV/码] × 1e-6 × r

k 保持 ROM 引脚 LSB，b 为零点，r 为端子变比（int32 Q16）。
变比不能并进 k：UA 端子域 k 达 1.5e5 µV/码、Q16 溢出 int32；
r 单独存 Q16 不溢出。两点标定改标 r，k 仍是板级事实。

- 新开单段 [adc_cal_sec]（8 键 r_ua..r_in），cfg 段数达 8/8 上限
- 一次变比复用 prot_set 四项，不新开段；r=0 表示本路不折算
- ROM 默认带台架实测变比（电压族 1000、电流族 29.4118），
  烧进固件即显二次值；VALID 仍须两点标定，两者互不派生
- eng 判据改「每路要么已配变比、要么削顶不显示」，不再看 VALID
- 104 地址 0x8050~0x8057 写 r，run_par_cal_r_set 写值与置脏同函数
- 录波 v2：通道表加 int32 r_q16，头 128→160、整段 5250→5282；
  code_to_milli 用余数分解换等价单次圆整，20 万组大整数对拍 0 不符
- 文档同步：采集与算法层/通道映射/故障录波/网络配置/配置文件/
  产品需求/内存台账，历史带日期实测数字按冻结口径不改
- 单测 13 套全绿，/keil-build 0 错误 0 警告（256024/31760/
  2080/152368），RAM 实测回填内存内容分配策略 §6.1

scripts/ram_baseline.tsv

@@ -20,3 +20,4 @@ date	code	ro	rw	zi	er_irom1	er_pct	iram1	iram1_pct	ccm	ccm_pct	top_rwzi
 2026-11-05	254820	30896	2072	150104	285716	27.2	94752	72.3	57376	87.9	heap_4.o=57376;lv_mem_core_builtin.o=16384;lftpd.o=7884;ui_net_sink.o=6802;ui_port.o=6432;nand_ftl.o=6236;wave_ring.o=5296;sb_link.o=4376;ch395f.o=4162;console_log.o=4132
 2026-11-09	255160	31204	2080	152152	286364	27.3	96808	73.9	57376	87.9	heap_4.o=57376;lv_mem_core_builtin.o=16384;nand_ftl.o=8288;lftpd.o=7884;ui_net_sink.o=6802;ui_port.o=6432;wave_ring.o=5296;sb_link.o=4376;ch395f.o=4162;console_log.o=4132
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+2026-11-11	256024	31760	2080	152368	287784	27.4	97024	74.0	57376	87.9	heap_4.o=57376;lv_mem_core_builtin.o=16384;nand_ftl.o=8288;lftpd.o=7884;ui_net_sink.o=6802;ui_port.o=6432;wave_ring.o=5332;sb_link.o=4376;ch395f.o=4162;console_log.o=4132